职责描述：1、根据电路设计要求完成芯片版图布局，包括信号走线、电阻及晶体管的匹配、大电流走线、ESD器件、Latch up rule 等方面的考虑；2、负责版图的验证，包括DRC、LVS、ANT、ERC、Latch-Up、ESD等；3、负责子模块的布局布线，包括匹配、noise隔离、高低压隔离、电流密度检查、WPE、LOD效应规避等；4、熟悉VI命令的使用；5、熟悉command file及简单的编写；6、熟悉.il文件及简单编写。任职要求：1、本科及以上学历，微电子/电子工程/版图设计相关专业；2、一年以上IC Layout工作经验，熟练使用Cadence Virtuoso XL版图设计工具；3、熟悉Linux/Unix操作系统，熟练使用Calibre进行DRC/LVS/XRC验证；4、有较强的责任心和独立工作能力，工作态度严谨，具有良好的团队合作精神；5、熟悉匹配、寄生、Latch-up、天线效应等发生机制及解决办法；6、对IC设计流程；半导体制造工艺；半导体器件及模拟电路有一定的理解；7、除了版图方面，对相关的设计有了解：PCB、封装、FIB、仿真，测试等。

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