岗位职责：1、参与Serdes IP内部模块的设计、仿真和流片；2、负责相关IP的交付、测试与客户支持；3、从布局、匹配、寄生等方面指导版图设计和优化。岗位要求： 1、微电子、半导体及理工类相关专业，本科及以上学历，2年以上相关学习或项目经验；2、有高速TX、RX、AFE、DFE、PI、PLL等电路设计经验者优先；3、具备较强的模拟基础和VSLI高速电路理论功底，擅长考虑非理想条件下的模拟设计和VLSI电路分析、理解post layout分析和时序；4、深刻理解各种器件和布局布线的物理原理，掌握全定制电路画图方法和工具，理解快、画图快，能够分析并解决寄生、匹配、功耗、电压降以及串扰等问题；5、有学习新的相关技术和工具的热情，具有逻辑和创造性的思维能力，具有英语交流能力，沟通和解决问题的能力。

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